Formatierung 2.3

This commit is contained in:
Lukas Hindahl
2023-10-04 10:26:00 +02:00
parent d958e3f12e
commit 17aca32ca4
+1
View File
@@ -1,4 +1,5 @@
\subsection{Ermittlung der Signalverfälschung bei unterschiedlichen Abschlusswiderständen}
\vspace{0.5cm}
In diesem Abschnitt werden drei Diagramme dargestellt. Es behandelt die Signalverfälschung bei unterschiedlichen Abschlusswiderständen, in diesem Fall bei Leerlauf, Kurzschluss und mit einem $50$ \unit{\ohm} Widerstand.
\begin{figure}[H]
\centering