 Matthias Biermann
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cd9d44e26d
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Abschnitt zum Bare-metal Programm
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2025-02-18 14:07:47 +01:00 |
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Matthias Biermann
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3fa4317f7f
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Kapitel Anhang
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2025-02-18 13:48:28 +01:00 |
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Matthias Biermann
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f1daff77b2
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kleinere Korrekturen
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2025-02-17 21:17:17 +01:00 |
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Matthias Biermann
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cafa294371
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Logdateien
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2025-02-17 12:54:57 +01:00 |
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Matthias Biermann
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0cda8a9bd1
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Kleinere Änderungen
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2025-02-17 11:02:02 +01:00 |
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Matthias Biermann
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f7fd82380f
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Bericht voerst fertig
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2025-02-16 18:56:52 +01:00 |
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Matthias Biermann
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77852ca4ca
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Datenzähler
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2025-02-16 16:55:45 +01:00 |
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Matthias Biermann
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28c434011b
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Logdatei
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2025-02-16 16:21:44 +01:00 |
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Matthias Biermann
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b221edf9f4
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Bericht: Testkonzept fast fertig
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2025-02-16 15:34:02 +01:00 |
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Matthias Biermann
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f2d179a6f2
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Bericht: Testkonzept angefangen
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2025-02-15 15:42:33 +01:00 |
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Matthias Biermann
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21cc5a2b06
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do not keep build dir
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2025-02-15 15:40:39 +01:00 |
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Matthias Biermann
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87da79f1b2
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keep build directory
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2025-02-15 15:38:31 +01:00 |
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Matthias Biermann
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6107cbb093
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Bericht: Theoretische Grundlagen
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2025-02-15 15:31:45 +01:00 |
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Matthias Biermann
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c761e6964f
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Bericht: Konzept und Umsetzung
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2025-02-15 13:35:57 +01:00 |
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Matthias Biermann
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e4170a43c6
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Doku: Kapitel 2 angefangen
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2025-02-14 16:18:38 +01:00 |
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Matthias Biermann
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d126a6cb1d
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Typo in Headdatei
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2025-02-14 16:18:22 +01:00 |
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Matthias Biermann
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88f03775e6
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Blockschaltbilder
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2025-02-14 15:00:49 +01:00 |
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Matthias Biermann
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423872a96d
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LaTex Blanko Projekt für Projektbericht
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2025-02-14 01:47:41 +01:00 |
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Matthias Biermann
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2fc4a31322
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Software und Hardware final
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2025-02-13 22:55:36 +01:00 |
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Matthias Biermann
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49b5702aa4
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Software fast final
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2025-02-13 20:02:30 +01:00 |
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Matthias Biermann
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ff36946543
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axis_dma: Adresszähler gefixt + Software zwischenstand
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2025-02-13 18:04:02 +01:00 |
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Matthias Biermann
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45bb63cfb8
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M_AXI Fehler gefixt
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2025-02-12 21:33:51 +01:00 |
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Matthias Biermann
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9a4bbbbc97
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clean Vivado Project dma_bare_metal
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2025-02-12 18:23:19 +01:00 |
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Matthias Biermann
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02f64cb68d
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aufräumen
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2025-02-12 18:04:23 +01:00 |
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Matthias Biermann
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1edb0e96b6
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axi_crc_dma als eigenes Blockschaltbild
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2025-02-12 16:33:08 +01:00 |
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Matthias Biermann
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dbbb9c14b6
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M_AXI_WLAST Fehler in axis_dma korrigiert
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2025-02-12 14:17:02 +01:00 |
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Matthias Biermann
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a0d36c3523
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Input Output Reflected hinzugefuegt
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2025-02-12 11:57:44 +01:00 |
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Matthias Biermann
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ba7b4d18fa
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axis_crc Timing + TB verbessert
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2025-02-11 20:22:55 +01:00 |
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Matthias Biermann
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7725db8f3b
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Komischer Fehler: IP kann nicht in Speicher schreiben
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2025-02-11 18:30:08 +01:00 |
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Matthias Biermann
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cb45038dba
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CRC Software leicht angepasst
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2025-02-11 12:01:22 +01:00 |
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Matthias Biermann
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708eac19c2
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FinalXOR nach außen führen
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2025-02-10 22:50:15 +01:00 |
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Matthias Biermann
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9a37389d48
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axis_crc: Inital value, Final XOR und Input/Output reflected aber dafür Timingfehler
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2025-02-10 13:10:23 +01:00 |
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Matthias Biermann
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4fd406f3ab
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CRC Berechnung in axis_crc gefixt
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2025-02-09 17:36:30 +01:00 |
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Matthias Biermann
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393ea44d9a
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axi_crc_dma
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2025-02-09 17:09:21 +01:00 |
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Matthias Biermann
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29d2fb8183
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AXI Schreiben
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2025-02-08 17:22:35 +01:00 |
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Matthias Biermann
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529f1a10d2
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axis_crc Fehler gefixt
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2025-02-02 05:17:10 +01:00 |
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Matthias Biermann
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0f8be1a934
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axis_dma angefangen
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2025-02-02 01:01:23 +01:00 |
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Matthias Biermann
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027c4dd5ba
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basic axis_crc_tb läuft
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2025-02-01 20:28:53 +01:00 |
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Matthias Biermann
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b786fa8a51
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axis_crc.vhd separierter Ansatz
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2025-02-01 14:15:55 +01:00 |
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Matthias Biermann
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a7a8064bbe
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Altes Konzept ins Archiv
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2025-01-31 17:47:31 +01:00 |
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Matthias Biermann
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e67d427e1e
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crc_axi_master
Altes_Konzept
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2025-01-31 17:26:04 +01:00 |
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Matthias Biermann
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97fee743f0
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crc_aci_master fertig
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2025-01-31 02:08:21 +01:00 |
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Matthias Biermann
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1af1041c75
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schreiben will nich
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2025-01-30 23:36:34 +01:00 |
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Matthias Biermann
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0b52a30c62
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axi_master schreiben
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2025-01-30 11:49:12 +01:00 |
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Matthias Biermann
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5fccf08c48
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axi_master lesen
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2025-01-29 20:26:29 +01:00 |
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Matthias Biermann
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ed5cae58ea
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axi_master angefangen
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2025-01-29 17:31:27 +01:00 |
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Matthias Biermann
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e11407ab25
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ram + axi_master angefanen
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2025-01-28 22:42:52 +01:00 |
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Matthias Biermann
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5a5cf7e000
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crc_axi_lite schnittstelle
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2025-01-27 22:43:11 +01:00 |
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Matthias Biermann
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8a141b47ff
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CRC Testbench + axr_crc architecture
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2025-01-26 14:17:13 +01:00 |
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Matthias Biermann
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4e34f728b4
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CRC timing test + entity of axi_crc component
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2025-01-25 11:53:10 +01:00 |
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